職位描述
Verilog HDLVHDLPython通信/網(wǎng)絡(luò)設(shè)備
崗位職責：
1、負責信號處理算法需求分析、完成導(dǎo)航、通信或雷達相關(guān)的信號處理算法方案設(shè)計與仿真；
2、負責設(shè)計實現(xiàn)無線通信、導(dǎo)航等應(yīng)用的物理層相關(guān)算法；
3、負責在FPGA上實現(xiàn)信號處理算法，負責代碼編寫、調(diào)試及維護；
4、負責技術(shù)或產(chǎn)品開發(fā)各個階段相關(guān)的技術(shù)評審和技術(shù)文件編寫；
5、解決研制、生產(chǎn)過程中出現(xiàn)的算法問題。
任職要求：
1、熟練掌握Matlab或Python工具進行仿真；
2、熟悉Verilog/VHDL語言；
3、具有FPGA工程實現(xiàn)相關(guān)項目經(jīng)驗優(yōu)先；
4、具有擴跳頻設(shè)計、通信調(diào)制解調(diào)、信道編解碼或雷達信號處理算法相關(guān)經(jīng)驗優(yōu)先；
5、具有數(shù)據(jù)鏈、自組網(wǎng)相關(guān)經(jīng)驗（鏈路層接入設(shè)計和物理層波形設(shè)計）或神經(jīng)網(wǎng)絡(luò)研究的相關(guān)經(jīng)驗者優(yōu)先；
6、具有較強的溝通表達能力。
工作地點
成都郫都區(qū)天奧科技產(chǎn)業(yè)園
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